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未來將按原子模型設(shè)計芯片

摘要:<正>越來越小和越來越復(fù)雜的芯片對今天半導(dǎo)體制造材料的限制提出了前所未有的制造挑戰(zhàn)。不過,一種旨在克服技術(shù)局限性和薄膜制造成本障礙的技術(shù)可以使器件的尺寸繼續(xù)下降,這就是被稱為原子層沉積(ALD)的技術(shù)。

關(guān)鍵詞:
  • 半導(dǎo)體制造  
  • 制造成本  
  • 技術(shù)局限性  
  • 原子模型  
  • 原子層沉積  
  • 市場研究機構(gòu)  
  • 制造設(shè)備  
  • 摩爾定律  
  • 技術(shù)副總裁  
作者:
Ann; Steffora; Mutschle
單位:
刊名:
電子經(jīng)理世界

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期刊名稱:電子經(jīng)理世界

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